雅馬哈斜線移動芯片功率泄漏與節(jié)奏的工具

節(jié)奏設計系統已經宣布,雅馬哈利用節(jié)奏低能耗解決方案的組件實現漏電功耗降低50%在其最新的智能手機芯片。

雅馬哈所使用的工具包括節(jié)奏遇到RTL編譯器(RC),節(jié)奏遇到保形低功率(CLP)和節(jié)奏遇到數字實現(EDI)系統。

“低功率是我們新的移動芯片設計的關鍵,“修治Ito說,開發(fā)總監(jiān),雅馬哈公司。”,因為這些工具在節(jié)奏低功耗方案支持常見的格式,它允許我們利用先進的電源管理技術,導致更好的力量和對我們的設計性能和較短的周轉時間。”

解決方案支持許多先進低功耗技術,如multi-supply電壓、電源關閉和multi-bit細胞推論,還原能力的關鍵。

除了減少泄漏,雅馬哈利用目標的解決方案來實現設計關閉性能和功率。

解決方案的設計工具支持電源管理意圖一致共同權力所描述的格式(CPF)等所有設計階段實現和驗證(RTL)GDSII register-transfer水平。

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